要約:
人工知能およびハイパフォーマンス コンピューティング (HPC) チップに対する世界的な需要が制御不能なほど増大し続ける中、世界有数のファウンドリである TSMC は前例のない深刻な納期のボトルネックに直面しています。半導体サプライチェーンと権威ある業界に関する最新の分析レポートによると、TSMCは今後数年間で新たな抜本的拡大に着手する予定で、2028年までに中核となるCoWoS（チップ・オン・ウェーハ・オン・サブストレート）先進パッケージングの生産能力を2倍以上にすることを目標としている。一方で、既存の生産能力は既にエヌビディアなどの巨人に先行して引き継がれており、供給が不足しているため、インテルや台湾のパッケージング・テストファウンドリ企業へのAIチップ先端パッケージングの大量発注が加速しており、大規模な波及が起きている。
現在の大型モデルのインフラストラクチャ コンピューティングのパワーアーム競争において、世界的な AI アクセラレータ カードの出荷ペースを真に制限する根本的な要因は、フロントエンドの高度なプロセスのウェーハ ファウンドリからバックエンドの 2.5D および 3D の高度なパッケージング リンクに移行しています。 TSMC は、その成熟した奥深い CoWoS テクノロジー システムにより、Nvidia、AMD、Broadcom などの世界のトップ コンピューティング パワー巨人にとって、長年にわたり絶対的な第一選択肢であり続けています。しかし、TSMCは過去2年間でパッケージング能力を継続的に2倍にしてきたとはいえ、その能力拡大のペースは依然としてAIコンピューティング能力に対する市場の底なしの需要には遠く及ばない。業界の推計によれば、NVIDIA だけで TSMC の CoWoS 総生産能力の約 60% を占めており、将来の拡張割り当ての半分以上を事前に確保しています。上位 3 社の顧客は生産能力シェアの 85% 以上を奪い、CoWoS 生産ライン全体のリードタイムが 52 週間を超えて 78 週間に大幅に延長され、2026 年、さらには 2027 年の空席はすでに予約されています。
この長期的な構造的ギャップに対処するために、TSMC は設備投資と工場リソースの動員を加速し、台湾の複数の先端包装工場から将来の新興拠点への大規模設備の導入を推進し、2028 年までに月産能力を現在の逼迫した状態から 2 倍にしようと努めています。しかし、遠くにある水がすぐに喉の渇きを潤すことはできません。生産スケジュールが非常にタイトなため、出荷を熱望する下流のチップ設計顧客に耐え難い待機コストが発生し、チップ製造史上まれな「注文波及効果」を直接引き起こしています。
TSMC のスケジュールでは十分なパッケージング割り当てを獲得できないため、アドバンスト マイクロ デバイス (AMD) を含む多くの大手チップ メーカーは、生産能力の供給ソリューションを多様化し、一部の注文と次世代パッケージングのニーズを競合他社に転用する必要に迫られました。直接の受益者として、米国政府の政策基金の支援を受けて先進パッケージング事業に積極的に賭けているインテルは、EMIB (組み込み型マルチチップ相互接続ブリッジ) とより高度な EMIB-T テクノロジーを利用してオーバーフロー顧客を獲得し、世界第 2 位の先進パッケージング サービス プロバイダーに参入するという目標を加速しています。同時に、ASE、SPIL、Powertech、KYEC などの Sun and Moon Professional のアウトソーシング半導体パッケージングおよびテスト (OSAT) メーカーも、より柔軟な納期と徐々に成熟した 2.5D パッケージングおよびテストプロセスにより、前例のない注文の波とパフォーマンスの爆発的な増加をもたらしました。
半導体業界のアナリストは、2028 年までに CoWoS の生産能力を倍増させるという TSMC の野心的な計画は、AI インフラストラクチャの構築が短期的なパルスではなく、数年間にわたるコンピューティング電力インフラストラクチャの長距離運用を反映していると指摘しています。注文の溢れは客観的に見て、インテルとサードパーティのパッケージングおよびテスト工場に、環境保護の声をつかむための戦略的突破口を与えているが、TSMC にとって、既存の制限された生産能力を最も高い利益率と最先端のプロセス技術を持つトップコア顧客に優先することは、高い粗利益の収穫を最大化するのにも役立つだろう。今後数年間で高度なプロセスと高度なプロセスのパッケージングが徹底的に統合されることにより、高度なパッケージング分野における生産能力をめぐる戦いは、世界の半導体産業チェーン全体の競争環境を再形成する中核となる勝者へと進化しつつある。
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